3. Problèmes matériels accentués
3.1 Bancs de registres
Dans le pipeline simple de la figure 3 (cas scalaire), une instruction dans la phase DI/LR peut lire le contenu de deux registres et une autre peut écrire dans la phase ER dans un autre registre. Le problème de la lecture et de l'écriture simultanée dans un même registre peut être résolu de deux manières :
1) si la période d'horloge est au moins le double du temps de lecture...
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Problèmes matériels accentués
Modèle multi-pipeline
Sources bibliographiques
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