Vers le test des SoC
Test des circuits intégrés numériques - Conception orientée testabilité

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Vers le test des SoC
Test des circuits intégrés numériques - Conception orientée testabilité

Auteur(s) : Régis LEVEUGLE

Date de publication : 10 août 2002

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3. Vers le test des SoC

L’évolution des modèles de fautes pour les technologies récentes a été présentée dans l’article [E 2 460] , § 2.3. En parallèle de cette évolution, les technologies submicroniques profondes (DSM) induisent, pour les circuits les plus pointus (SoC ou système sur une puce), de nouveaux problèmes liés :

  • à l’augmentation de la complexité des éléments intégrés ;

  • à l’augmentation de la densité d’intégration ;

  • à la forte croissance des fréquences d’horloges ;

  • à la diminution requise des coûts.

  • L’ augmentation de la complexité des circuits ...

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