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Transistors et circuits intégrés à hétérostructures (III-V)ARCHIVE | Réf : E2455 v1
Auteur(s) : Frédéric ROUSSEAU
Date de publication : 10 févr. 2005
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La synthèse logique et la conception physique constituent la partie bas niveau (back-end ) de la conception d’un système par opposition à la conception de haut niveau (front-end ).
La synthèse logique est une étape de conception qui transforme une description RTL en un réseau de portes logiques (figure 12). Cette étape est maintenant réalisée automatiquement à l’aide d’outils de synthèse commerciaux très efficaces.
La conception physique correspond aux étapes ultimes de la conception des circuits intégrés (figure 12). Les résultats représentent l’implémentation pour obtenir le dessin des masques utiles à la fabrication du circuit. Les trois étapes principales sont le placement, le routage et la vérification du dessin physique (layout ). Ces étapes de conception sont automatisées depuis les années 1980.
Les principes de base de la synthèse logique et de la conception physique sont développés dans [8].
La synthèse logique regroupe deux étapes qui sont effectuées séquentiellement : l’optimisation logique et la conversion (ou projection) technologique (technology mapping ).
L’optimisation logique est appliquée pour réduire la complexité du modèle RTL. On cherche alors à limiter la redondance des calculs, tout en préservant la fonctionnalité du circuit. On utilise des techniques d’optimisation booléennes telles que l’algorithme de Quine/ MacCluskey développé dans les années 1950 ou d’autres versions améliorées qui réduisent le nombre de littéraux (un littéral est l’apparition d’une variable dans une équation) des équations booléennes, donc le nombre de portes logiques réalisant cette fonction.
la fonction :
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ÉLECTRONIQUE
(1) - AIRIAU (R.), BERGE (J.M.), OLIVE (V.), ROUILLARD (J.) - VHDL : langage, modélisation, synthèse. - Presses Polytechniques et Universitaires Romandes (1998).
(2) - DE MICHELI (G.) - Synthesis and Optimization of digital Circuits. - Graw Hill (1994).
(3) - GAJSKI (D.) - High Level Synthesis : Introduction to Chip and System Design. - Kluwer Academic Publishers (1992).
(4) - GAJSKI (D.D.), VAHID (F.) - Specification and Design of Embedded Hardware-Software Systems. - IEEE Design & Test of Computers, p. 53-67, printemps (1995).
(5) - GAJSKI (D.D.), ZHU (J.), ZOMER (R.), GERSTLAUER (A.), ZHAO (S.) - SpecC Specification Language and Methodology. - Kluwer Academic Publishers (1997).
(6) - JERRAYA (A.A.) - Behavioral Synthesis and Component reuse with VHDL. - Kluwer Academic Publishers (1997).
SystemC Design Language http://www.systemc.org/
Laboratoire TIMA http://tima.imag.fr/
Design Automation Conference http://www.dac.com/
Design Automation & Test in Europe http://www.date-conference.com/
International Technology Roadmap for Semiconductors (ITRS) http://public.itrs.net/
Vendeurs d’outils de CAO : Synopsys http://www.synopsys.com/
Cadence http://www.cadence.com/
HAUT DE PAGE2 Thèses récentes (concernant le paragraphe 5.1)
* - http://corail.sudoc.abes.fr
GHARSALLI (F.) - Conception des interfaces logiciel-matériel pour l’intégration des mémoires globales dans les systèmes monopuces. - Thèse de doctorat d’informatique, INPG, soutenue le 1er juillet 2003.
BAGHDADI (A.) - Exploration et conception systématique d’architectures multiprocesseurs monopuces dédiées à des applications spécifiques. - Thèse de doctorat de microélectronique, INPG, soutenue le 14 mai 2002.
* - Un exemple de système intégré monopuce est montré figure .
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