5. Évolution de l’interface
L’interface a longtemps été négligée par les concepteurs. On peut dire qu’elle est restée figée pendant les dix premières années après sa première commercialisation. Classiquement, la mémoire nécessite une adresse, un port d’E/S de l’information DQ et des signaux de contrôle, au minimum la spécification du type d’accès R/#W. Pour dialoguer avec le processeur, des bus dédiés ont été nécessaires. Ce sont les bus d’adresse, de données et de contrôle. Pour augmenter le débit, l’augmentation de la largeur des chemins de données et d’adresse a été proposée. Par ailleurs, l’interface de la mémoire vive statique a commencé à évoluer vers la fin des années 1970 avec l’utilisation d’un signal d’horloge externe. Celle de la mémoire vive dynamique a suivi dans les débuts des années 1990 avec le modèle SDRAM.
5.1 Augmentation des formats de donnée et d’adresse
À l’origine, le format de sortie n de donnée était d’un bit. Pour augmenter le débit, l’élargissement à un format supérieur est une solution. Elle est employée en interne du boîtier, au niveau de toute la hiérarchie ou au niveau du sous-ensemble mémoire de l’ordinateur sous la forme de barrettes appelées banc externe ou rangée (rank) à l’aide d’un entrelacement. Cette solution augmente le débit mais ne diminue pas le temps d’accès.
L’adressage de la DRAM est multiplexé dans le temps (adresse de ligne puis adresse de colonne), la justification étant historique afin de minimiser le nombre de broches du boîtier. Présenter une adresse complète apporte un gain de temps au niveau de son décodage, approche de la FCRAM (Fast Cycle RAM).
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5.2 Approche synchrone
Quand on observe un accès asynchrone à la mémoire, par exemple en écriture (figure 29), on remarque que le bus d’adresse est occupé pendant tout le cycle (durée t WC).
Pour diminuer ce temps de blocage du bus par la mémoire et, par la suite, augmenter...
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