3. Évolution de la logique de contrôle
La logique de contrôle (figure 12), périphérique au plan de mémorisation, concerne principalement le décodeur d’adresse de ligne de mot, le conditionneur de ligne de bit, l’amplificateur de lecture SA, ainsi que le multiplexeur de colonnes (MUX). Ce dernier regroupe les fonctions de décodage d’adresse de colonne et de sélection d’une colonne.
3.1 Décodeur d’adresse de ligne
Le rôle des décodeurs d’adresse est de sélectionner une ligne et une colonne afin d’adresser par coïncidence la cellule de mémorisation. Pour cela, l’adresse fournie à la mémoire est décomposée en deux champs, l’adresse de ligne, de poids le plus élevé, et celle de colonne. Par ailleurs, il faut distinguer le décodeur d’adresse de ligne et celui de colonne. En effet, ce dernier, associé à un sélectionneur, est en fait un multiplexeur qui permet de faire circuler l’information binaire de ou vers la cellule.
Le décodeur d’adresse de ligne est chargé, à partir de l’adresse, d’activer une unique ligne. L’augmentation de la capacité de mémorisation a fait augmenter le degré des mintermes de son équation booléenne. Au niveau implémentation dans une technologie CMOS, cela implique des étages d’entrées avec un nombre élevé de transistors en série, qui entraîne une dégradation des temps de commutation proportionnels à l’entrance des portes. La solution usuellement retenue pour minimiser le nombre d’entrées est de réaliser un décodage en deux étapes dénommées « prédécodage » et « décodage final » comme l’illustre la figure 13. Une autre fonction est l’amplification électrique car chacune de ses sorties voit une capacité de ligne élevée.
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3.2 Amplificateur de lecture
L’amplificateur de lecture (SA) est l’élément critique de la mémoire, surtout pour la DRAM, car il doit déterminer un niveau logique à partir d’une différence de tensions de l’ordre de la centaine de millivolts....
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