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Opérateurs logiques - Exemples de réalisationsARCHIVE | Réf : E182 v2
Auteur(s) : Daniel ETIEMBLE
Date de publication : 10 août 2013
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Les réseaux logiques programmables sont des circuits qui permettent à l'utilisateur de disposer d'éléments logiques de base combinatoires et séquentiels d'une certaine granularité dont il « programme » lui-même les connexions. Il s'agit d'une programmation des interconnexions des éléments matériels de base, qu'il ne faut pas confondre avec la programmation logicielle (écriture d'un programme) d'un processeur. La possibilité de programmer les interconnexions se traduit par des performances moins bonnes par rapport aux circuits ASIC « full custom » pour une application à la fois en termes de fréquence d'horloge et de densité d'intégration. Pour un coût bien moindre, ils fournissent à l'utilisateur des performances suffisantes pour une très large gamme d'applications, en fonction des différents types de circuits logiques programmables disponibles. De plus, lorsqu'une application a été développée et fonctionne sur un réseau logique programmable, il est possible, si le nombre de circuits nécessaires le justifie, de la faire migrer de manière « automatique » vers un circuit de type ASIC en câblant les interconnexions pour obtenir des vitesses supérieures à surface de silicium réduite par rapport au réseau logique programmable, même si les performances restent inférieures à celles d'un circuit complètement optimisé pour l'application.
On peut classer les réseaux logiques programmables en trois grandes catégories, qui correspondent à différentes classes d'application :
les réseaux programmables simples, connus sous l'acronyme SPLD (Simple Programmable Logic Devices) (§ 4.2) ;
les réseaux programmables complexes, connus sous l'acronyme CPLD (Complex Programmable Logic Devices) (§ 4.3) ;
les réseaux de portes programmables de l'extérieur, connus sous l'acronyme FPGA (Field Programmable Gate Arrays) (§ 4.4).
Les deux fournisseurs principaux de réseaux logiques programmables en 2012 sont Altera et Xilinx (voir adresses dans « Pour en savoir plus »). Une liste plus complète peut être trouvée dans l'article ...
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(1) - BORKAR (S.) - Design challenges of technology scaling, - IEEE Micro, July-August 1999.
(2) - POLLACK (F. J.) - New microarchitecture challenges in the coming generations of CMOS process technologies, - MICRO 1999, disponible à l'URL http://research.ac.upc.edu/HPCseminar/SEM9900/Pollack1.pdf.
(3) - BOHR (M.), MISTRY (K.) - Intel revolutionary 22 nm transitor technology, - http://newsroom.intel.com/docs/DOC-2032.
(4) - * - ITRS, (International Technology Roadmap for Semiconductors), http://www.itrs.net/
(5) - ANCEAU (F.), BONNASSIEUX (Y.) - Conception des circuits VLSI du composant au système, - Dunod (2007).
(6) - CURRAN (B.) et al. - Power-constrained high-frequency circuits for the IBM POWER6 microprocessor, - IBM. J. Res&Dev, vol 51, no 6, November...
Conception des systèmes VLSI,
Évolution de l'architecture des ordinateurs
Hiérarchies mémoire : les caches,
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