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Nanoélectronique, un passeport pour le nanomondeArticle de référence | Réf : RE255 v1
Auteur(s) : Mickael GROS-JEAN, Arnaud MANTOUX
Date de publication : 10 nov. 2016
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Technologie silicium sur isolant (SOI)Cet article fait partie de l’offre
Électronique (231 articles en ce moment)
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Vers la fin des années 1990, l’aluminium a été remplacé par du cuivre pour la fabrication des interconnexions métalliques car ce dernier possède une résistivité plus faible, ce qui permet au signal électrique de se propager plus rapidement dans le circuit . Les interconnexions sont formées des lignes de cuivre sur différents niveaux (jusqu’à 12), chaque niveau étant connecté par des plots de cuivre (figures 5 b et 13 a). Ces lignes et ces plots sont fabriqués par gravure de tranchées et de puits dans des isolants puis remplis par voie électrochimique en phase liquide.
L’introduction du cuivre a dû être accompagnée par l’introduction de couches barrières à base de tantale ou de titane, ces couches permettant d’éviter la diffusion d’atomes de cuivre vers les isolants. Ce sont typiquement des empilements TaN/Ta ou TiN/Ta d’environ 10 nm qui sont employés, et ces matériaux doivent être déposés dans le fond et sur les parois des cavités, sans laisser de zones non recouvertes. Outre l’uniformité des dépôts dans des topologies complexes, les propriétés que ces couches doivent respecter sont une bonne adhésion sur les diélectriques, une bonne capacité à bloquer la diffusion du cuivre, et une résistivité la plus faible possible pour conserver une conductivité moyenne de ligne élevée. Ces propriétés doivent être obtenues pour des températures inférieures à 400 °C pour ne pas dégrader les couches sous-jacentes et pour ne pas faire diffuser les différents éléments présents dans les structures. Une fine couche de cuivre doit également être déposée sur la barrière afin d’initier le dépôt électrochimique de cuivre.
En général, les couches barrière et la couche de cuivre sont déposées par pulvérisation (ou PVD pour Physical Vapor Deposition) et de nombreuses études ont...
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(1) - BERTHELOT (A.) et al - * - ICMTD proceedings, 127 (2007).
(2) - WEINREICH (W.) et al - * - J. Vac. Sci. Technol., A31(1), 01A119 (2013).
(3) - HIGASHI (G.S.) et al - * - Appl. Phys. Lett., 55, 1963 (1989).
(4) - SOTO (C.) et al - * - J. Vac. Sci. Technol. À, 9, 2686 (1991).
(5) - PUURUNEN (R.) et al - * - J. Appl. Phys, 97, 121301 (2005).
(6) - X. ZHAO (X.) et al - * - Phys. Rev. B, 65, 075105 (2002).
(7) - MIIKKULAINEN (V.) et al - * - J. of Appl. Phys., 113,...
Circuits en couches minces – Couches minces traditionnelles,
Atomic Layer Deposition (ALD) Principes généraux, matériaux et applications.
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