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Processeurs à grand nombre de cœurs (manycores)Article de référence | Réf : H1088 v2
Auteur(s) : Franck CAPPELLO, Daniel ETIEMBLE
Date de publication : 10 août 2017
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Technologies logicielles Architectures des systèmes (225 articles en ce moment)
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Ce paragraphe introduit différentes mesures de la performance : performance crête, accélération.
La performance la plus simple à calculer mais aussi la moins utile pour prédire les performances d’une architecture parallèle est la performance crête. Elle est simplement obtenue par la multiplication de la performance crête individuelle de toutes les unités de traitement par leur nombre dans l’architecture.
Une définition très utilisée de la performance crête est : la performance dont le constructeur vous garantit que vous ne pourrez pas la dépasser !
Une information plus pertinente est le temps de calcul d’une application (ou temps d’exécution). On peut en dériver le débit de calcul sur des nombres flottants ou des nombres entiers. La formule suivante donne le débit de traitement en fonction du temps de calcul :
Le dividende représente le nombre d’opérations que l’application nécessite pour son calcul.
Exemple : le nombre d’opérations flottantes pour le produit de matrices carrées est 2 n 3 si n est la taille du côté de la matrice. Avec un côté de 1 000 éléments, il y a donc 2 x 109 calculs à réaliser. Si le temps de traitement est de 1 seconde, le débit de calcul est de 2 x 109 opérations flottantes par seconde ; soit 2 gigaFlops.
Dans des programmes plus compliqués, cette information est peu pertinente, car le temps d’exécution des opérations flottantes varie beaucoup, des plus simples comme l’addition et la multiplication, à d’autres comme la division ou la racine carrée. Il faut alors, pour chaque architecture, prendre en compte les temps d’exécution individuels de chaque opération flottante.
Le temps d’exécution sert de base à la comparaison d’architectures pour le traitement d’une même application.
Avec la formule suivante :
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(1) - KOBAYASHI (H.) - Feasibility Study of a Future HPC System for Memory-Intensive Applications : Final Report. - Proceedings of the joint Workshop on Sustained Simulation Performance, University of Stuttgart (HLRS) and Tohoku University, pp 3-16 (2014).
(2) - KOBAYASHI (H.) - Feasibility Study of a Future HPC System for Memory-Intensive Applications : Final Report. - in SuperComputing, NEC Booth, http://jpn.nec.com/hpc/info/pdf/SC13_NEC_Tohoku_Prof.Kobayashi.pdf (2013).
(3) - BERNSTEIN (A.J.) - Analysis of Programs for Parallel Processing. - IEEE Transactions on Electronic Computers. EC-15 (5) : 757-763 (October 1966).
(4) - * - Intel® 64 and IA-32 Architectures Software Developer Manuals, http://www.intel.com/content/www/us/en/processors/architectures-software-developer-manuals.html.
(5) - * - ARM Synchronization Primitives, http://infocenter.arm.com/help/topic/com.arm.doc.dht0008a/DHT0008A_arm_synchronization_primitives.pdf.
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