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Extensions SIMD des jeux d'instructionsArticle de référence | Réf : H1201 v1
Auteur(s) : Daniel ETIEMBLE
Date de publication : 10 mai 2020
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Jeux d’instructions : extensions SIMD et extensions vectoriellesCet article fait partie de l’offre
Technologies logicielles Architectures des systèmes (215 articles en ce moment)
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Les développements et la mise en œuvre d’un jeu d’instructions libre impliquent l’adhésion d’une communauté de plus en plus large autour :
des développements matériels ;
des développements logiciels (simulateurs, débogueurs, compilateurs et bibliothèques, chargeurs et moniteurs, noyaux de système d’exploitation, distributions Linux, systèmes d’exploitation temps réel, etc.).
Une fondation RISC-V a été créée en 2015. Elle avait en mai 2019 plus de 250 membres ( https://riscv.org/) :
13 universités ;
29 consultants et chercheurs ;
23 firmes pour logiciels, outils de développement et nuage ;
104 développeurs individuels ;
51 firmes impliquées en IA, FPGA, circuits commerciaux, réseaux, graphiques, processeurs spécifiques ;
43 firmes impliquées au niveau circuits : concepteurs d’IP, fonderies, etc.
Un nombre significatif de firmes, notamment des fournisseurs d’IP, produisent des IP de processeurs RISC-V avec différents niveaux de taille, performances, puissances dissipées, etc. En novembre 2019, github ( https://github.com/riscv/riscv-cores-list) fournit une liste de 49 cœurs, 9 SoC et 20 plateformes SoC utilisant RISC-V.
Pour ne prendre que l’exemple d’une société basée en France, le catalogue de la société Cortus propose 6 cœurs différents utilisant différentes extensions du jeu d’instructions RISC-V.
La fondation RISC-V fournit également des documents pédagogiques en direction des universités.
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TECHNOLOGIES LOGICIELLES ARCHITECTURES DES SYSTÈMES
(1) - HILL (M.D.), CHRISTIE (D.), PATERSON (D.), YI (J.J.), CHIOU (D.), SENDAG (R.) - Proprietary versus Open Instruction Sets, - IEEE Micro, pp 58-68, July-August 2016. https://research.cs.wisc.edu/multifacet/papers/ieeemicro16_card_isa.pdf
(2) - OpenRISC 1000 Architecture Manual - https://opencores.org/websvn/filedetails?repname= openrisc&path=%2Fopenrisc%2Ftrunk%2 Fdocs%2Fopenrisc-arch-1.0-rev0.pdf
(3) - ASANOVIC (K.), PATTERSON (D.A.) - Instruction sets should be free: The case for RISC-V, - Technical Report N°UCB/EECS-2014-146, https://people.eecs.berkeley.edu/~krste/papers/EECS-2014-146.pdf
(4) - WATERMAN et al - The RISC Instruction Set Manual, Volume 1: User level ISA, version 2.0. - Technical Report N°UCB/EECS-2014-54.
(5) - WATERMAN (A.) - Design of the RISC-V Instruction Set Architecture, - Spring (2016), https://people.eecs.berkeley.edu/~krste/papers/EECS-2016-1.pdf
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