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Extensions SIMD des jeux d'instructionsArticle de référence | Réf : H1201 v1
Auteur(s) : Daniel ETIEMBLE
Date de publication : 10 mai 2020
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Jeux d’instructions : extensions SIMD et extensions vectoriellesCet article fait partie de l’offre
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4.1 Extension M : multiplication et division sur des entiers
La version RV32M définit des instructions de multiplication et de division opérant sur les registres entiers 32 bits et fournissant un résultat sur 32 bits :
quatre instructions de multiplication : mul délivre les 32 bits de poids faible. Les trois autres délivrent les 32 bits de poids fort (mulh avec des données signées, mulhu avec des données non signées et mulhsu avec des données signées et non signées) ;
quatre instructions de division 32 bits par 32 bits : div et divu pour des données signées et non signées, rem et remu pour les restes signés et non signés.
RV64M étend à 64 bits les opérations de RV32M et ajoute 5 instructions pour des données 32 bits avec extension de signe sur 64 bits : mulw, divw, divwu, remw et remuw.
HAUT DE PAGE4.2 Extension F : flottants en simple précision
L’extension F ajoute 32 registres 32 bits f0 à f31 pour les données en représentation flottante en simple précision et un registre de contrôle et d’état fcar.
Le registre fcar est manipulable via six instructions système.
Les instructions RV32 se décomposent en un certain nombre de classes :
les instructions d’accès mémoire flw et fsw ont le même mode d’adressage que les load et store sur les données entières. Elles transfèrent un mot de 32 bits entre la mémoire et un registre flottant ;
les instructions de calcul utilisent le format R : on trouve fadd.s, fsub.s, fmul.s, fdiv.s, fmin.s, fmax.s, fsqrt.s dont la signification est évidente ;
les instructions de conversion et de transfert. Les instructions de conversion convertissent des données flottantes en données entières 32 ou 64 bits, et réciproquement. Les instructions de manipulation de bit de signe copient le contenu d’un...
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(1) - HILL (M.D.), CHRISTIE (D.), PATERSON (D.), YI (J.J.), CHIOU (D.), SENDAG (R.) - Proprietary versus Open Instruction Sets, - IEEE Micro, pp 58-68, July-August 2016. https://research.cs.wisc.edu/multifacet/papers/ieeemicro16_card_isa.pdf
(2) - OpenRISC 1000 Architecture Manual - https://opencores.org/websvn/filedetails?repname= openrisc&path=%2Fopenrisc%2Ftrunk%2 Fdocs%2Fopenrisc-arch-1.0-rev0.pdf
(3) - ASANOVIC (K.), PATTERSON (D.A.) - Instruction sets should be free: The case for RISC-V, - Technical Report N°UCB/EECS-2014-146, https://people.eecs.berkeley.edu/~krste/papers/EECS-2014-146.pdf
(4) - WATERMAN et al - The RISC Instruction Set Manual, Volume 1: User level ISA, version 2.0. - Technical Report N°UCB/EECS-2014-54.
(5) - WATERMAN (A.) - Design of the RISC-V Instruction Set Architecture, - Spring (2016), https://people.eecs.berkeley.edu/~krste/papers/EECS-2016-1.pdf
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