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Hiérarchie mémoire : mémoire virtuelle| Réf : H1199 v1
Auteur(s) : Daniel ETIEMBLE
Date de publication : 10 févr. 2016
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Une instruction machine est constituée d'un certain nombre de bits décomposés en champs correspondant aux différentes informations à transmettre au matériel :
un champ code opération. La configuration de bits spécifie ce que fait l'instruction. Il peut y avoir correspondance directe entre le code contenu dans ce champ et une instruction, ou le code peut correspondre à une classe d'instructions et l'instruction est alors spécifiée par un champ extension du code opération ;
un ou plusieurs champs spécifient comment accéder aux données sur lesquelles sont effectuées les opérations. Les données peuvent être contenues dans des registres ou dans la mémoire. Certains champs peuvent spécifier directement des numéros de registre. Pour les données situées en mémoire, un champ doit spécifier la manière d'obtenir l'adresse mémoire de l'opérande, sauf si le code opération d'une instruction accédant à la mémoire définit implicitement le mode d'adressage. Les différents modes d'adressage disponibles sont une caractéristique du jeu d'instructions ;
certains champs peuvent contenir directement des données, qui peuvent être des constantes signées ou non signées généralement appelées immédiat ou peuvent être des constantes de type adresse appelées déplacement qui sont utilisées pour calculer les adresses de branchement et les adresses mémoire ;
certains champs peuvent être utilisés pour des instructions particulières. Par exemple, un champ repeat peut spécifier le nombre de caractères à transférer entre deux chaînes de caractères.
La taille des différents champs définit le nombre d'instructions, le nombre de registres utilisables, le nombre de modes d'adressage différents, l'amplitude des constantes données ou adresses représentables.
HAUT DE PAGE2.2 Nombre d'opérandes par instruction
Un calcul typique est du style :
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(1) - AMDAHL (G.M.), BLAAUW (G.A.), BROOKS (F.P.) Jr - Architecture of the IBM system/360. - IBM J. Research and Development, 8(2), p. 87-101, avr. 1964.
(2) - Intel® 64 and IA-32 architectures software developer manuals. - http://www.intel.fr/content/www/fr/fr/processors/architectures- software-developer-manuals.html
(3) - 80286 and 80287 programmer's reference manual. - http://bitsavers.informatik.uni-stuttgart.de/ pdf/intel/80286/210498-005_ 80286_and_80287_Programmers_Reference_Manual_1987.pdf
(4) - PATTERSON (D.A.) - Reduced instruction set computers. - Communications of the ACM – Special section on computer architecture, vol. 28, n° 1, p. 8-21, janv. 1985.
(5) - HENNESSY (J.L.), PATTERSON (D.A.) - Architecture des ordinateurs, une approche quantitative. - Vuibert Informatique (2003).
(6) -...
Hiérarchie mémoire : la mémoire virtuelle.
Processeurs : exécution pipeline des instructions.
Processeurs VLIW.
Les extensions SIMD des jeux d'instructions.
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